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K2 Space
Senior ASIC Design Verification Engineer
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PythonC++
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Die
K2 baut die größten und leistungsstärksten Satelliten, die jemals geflogen sind, und erschließt damit Leistungsniveaus, die bisher in jedem Orbit unerreichbar waren. Unterstützt durch insgesamt über $1 Milliarde an Finanzmitteln von führenden Investoren wie Altimeter Capital, ICONIQ, Kleiner Perkins, Lightspeed Venture Partners, Redpoint Ventures und T. Rowe Price – sowie mit über $1 Milliarde an unterzeichneten Verträgen mit kommerziellen Kunden und der US-Regierung – produzieren wir in Serie die leistungsstärksten Satellitenplattformen, die jemals für Missionen vom LEO bis in den tiefen Weltraum gebaut wurden.
Der Aufstieg von Schwerlast-Trägerraketen verschiebt die Branche von einer Ära der Massenbeschränkung hin zu einer Ära der Massenverfügbarkeit. Wir sind davon überzeugt, dass diese neue Ära eine grundlegend andere Klasse von Raumfahrzeugen erfordert. Die Satelliten von K2 sind so konstruiert, dass sie den härtesten Strahlungsumgebungen standhalten und die massiven Raketen von heute und morgen voll ausnutzen können. Sie bieten unübertroffene Fähigkeiten auf Konstellationsebene und über mehrere Orbits hinweg.
Mit mehreren Starts im Jahr 2027 und Plänen für eine Skalierung auf 100 Satelliten pro Jahr bauen wir größer – wir helfen dabei, das Sonnensystem zu erschließen und auf eine Zivilisation des Typs II nach Kardaschow (K2) hinzuarbeiten. Wenn Sie eine motivierte Persönlichkeit sind, die in einem schnelllebigen Umfeld aufblüht und sich darauf freut, zum Erfolg eines wachstumsstarken, mit Series D finanzierten Unternehmens beizutragen, würden wir uns freuen, wenn Sie sich bewerben.
Position Wir suchen einen Senior ASIC Design Verification Engineer
dessen Aufgabe es sein wird, die Funktionalität, Leistung und Robustheit unserer kundenspezifischen Siliziumdesigns zu verifizieren. Sie helfen dabei, den Verifizierungsansatz zu definieren, tragen zur Methodik bei und arbeiten eng mit Ingenieuren aus den Bereichen Architektur, RTL-Design, DFT, Firmware, Physical Design und Silizium-Validierung zusammen. Dies ist eine praxisorientierte Rolle mit hoher Eigenverantwortung, tiefgreifendem technischem Engagement und der Möglichkeit, Silizium der ersten Generation zu gestalten.
Aufgaben
- Entwicklung und Durchführung von Verifizierungsplänen für Umgebungen auf Block-, Subsystem- und Full-Chip-Ebene. Aufbau von SystemVerilog/UVM-Testbenches, einschließlich Agents, Monitoren, Scoreboards, Checkern und Coverage-Modellen.
- Schreiben von SystemVerilog Assertions (SVA) und Integration formaler Verifizierung, wo dies angemessen ist.
- Vorantreiben von Strategien für constrained-random und gerichtete Tests zur Validierung von Funktionalität, Randfällen und Stressszenarien.
- Durchführung von Simulationen, Triage von Fehlern, Durchführung von Ursachenanalysen und Zusammenarbeit mit RTL-Designern zur Lösung von Problemen.
- Implementierung und Pflege von funktionaler Coverage, Code-Coverage, Assertion-Coverage und Sicherstellung des Coverage-Abschlusses für das Sign-off.
- Verwaltung von Regressionstests, Simulations-Farms und CI-Pipelines, um einen hohen Testdurchsatz und schnelle Debug-Iterationen zu gewährleisten.
- Teilnahme an Design-Reviews, Diskussionen zur Mikroarchitektur und Einflussnahme auf Best Practices für Design-for-Verification (DFV).
- Enge Zusammenarbeit mit Ingenieuren aus den Bereichen Architektur, RTL-Design, DFT, Firmware, Physical Design und Silizium-Validierung, um eine End-to-End-Abdeckung und -Testung sicherzustellen.
- Unterstützung beim Silizium-Bring-up und der Post-Silizium-Validierung durch Testwiederverwendung, Diagnostik und Debug-Analyse.
- Teilnahme an Vorstellungsgesprächen für das ASIC-Team.
- Beitrag zur Weiterentwicklung von DV-Methoden und Verbesserungen.
- Einbindung externer IP-Anbieter und Verifizierungspartner bei Bedarf.
Qualifikationen
- B.S.- oder M.S.-Abschluss in Elektrotechnik, Informatik oder einem verwandten Bereich.
- 5+ Jahre Erfahrung in der ASIC/SoC-Verifizierung.
- Fundiertes Verständnis von SystemVerilog, digitaler Logik, RTL-Design und Hardware-Verifizierungsabläufen.
- Kenntnisse in Simulations-Tools (VCS, Xcelium, Questa), Waveform-Debug (Verdi, SimVision), Coverage-Tools und Skriptsprachen (z. B. Python, Perl, TCL).
- Erfahrung mit Testplanung, UVM-basierter Testbench-Entwicklung, constrained-random Testing, funktionaler Coverage und SystemVerilog Assertions.
- Erfahrung mit Regressionsmanagement, Coverage-Analyse, Revisionskontrolle (Git) und CI/CD-Automatisierung.
- Verständnis gängiger Industriestandard-Schnittstellen (z. B. APB/AHB/AXI).
- Vertrautheit mit eingebetteten prozessor-basierten Designs und Firmware/Bare-Metal-Programmierung (z. B. C, C++).
Wünschenswert
- Erfahrung in der Entwicklung und Integration von Referenzmodellen.
- Verständnis von Low-Power-Verifizierung.
- Vertrautheit mit Gate-Level-Simulation und analogen Verhaltensmodellen.
- Beteiligung an der Planung und Durchführung von Post-Silizium-Validierungen.
- Erfahrung in der Arbeit in funktionsübergreifenden, geografisch verteilten Teams.
- Erfahrung im Bereich Raumfahrt, Telekommunikation oder RF/digitalen gemischten Systemen ist ein Plus.
Vergütung und Leistungen
- Die Gehaltsspanne für diese Position liegt bei $170,000 – $250,000 zzgl. Unternehmensanteilen
- Das Gehalt basiert auf verschiedenen Faktoren, einschließlich, aber nicht beschränkt auf: Wissen und Fähigkeiten, Ausbildung und Erfahrungsgrad.
- Umfassendes Leistungspaket, einschließlich bezahltem Urlaub, Kranken-/Zahn-/Augenversicherung, Lebensversicherung, bezahltem Elternurlaub und vielen weiteren Vergünstigungen.
Exportkontrolle
Wenn Sie nicht 100% der bevorzugten Fähigkeiten und Erfahrungen mitbringen, ermutigen wir Sie dennoch, sich zu bewerben! Der Bau eines einzigartigen Raumfahrzeugs erfordert ein einzigartiges Team, und nicht-traditionelle Karrierewege sind ausdrücklich erwünscht!
Wenn Sie im Rahmen Ihrer Bewerbung oder für Vorstellungsgespräche eine angemessene Unterstützung (Reasonable Accommodation) benötigen, lassen Sie es uns bitte wissen.
Wie in der ITAR definiert, umfassen „U.S. Persons“ US-Staatsbürger, rechtmäßig ansässige Personen (d. h. Inhaber einer Green Card) und bestimmte geschützte Personen (z. B. Flüchtlinge/Asylberechtigte, Amerikanisch-Samoaner). Bitte konsultieren Sie einen sachkundigen Berater, wenn Sie sich nicht sicher sind, ob Sie eine „U.S. Person“ sind.
Die für diese Position eingestellte Person wird Zugang zu Informationen und Gegenständen haben, die den US-Exportkontrollvorschriften unterliegen, einschließlich der Exportkontrollvorschriften, die in der International Traffic in Arms Regulation (ITAR) dargelegt sind. Die für diese Rolle eingestellte Person muss daher entweder eine „U.S. Person“ gemäß 22 C.F.R. § 120.15 law.cornell.edu/cfr/text/22/120.15 sein oder anderweitig für eine staatlich ausgestellte Exportkontrolllizenz in Frage kommen.
Chancengleichheit
K2 Space ist ein Arbeitgeber, der Chancengleichheit fördert; die Beschäftigung bei K2 Space basiert auf Leistung, Kompetenz und Qualifikationen und wird in keiner Weise durch Rasse, Hautfarbe, Religion, Geschlecht, nationale Herkunft/Ethnie, Veteranenstatus, Behinderungsstatus, Alter, sexuelle Orientierung, Geschlechtsidentität, Familienstand, geistige oder körperliche Behinderung oder einen anderen gesetzlich geschützten Status beeinflusst.
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