ASIC Power Manager, ML Accelerators

Vereinigte Staaten

Sunnyvale, California, United States

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MINDESTQUALIFIKATIONEN: *

Abgeschlossenes Bachelor-Studium im Bereich Elektrotechnik, Technische Informatik, Informatik, einem verwandten Fachgebiet oder eine vergleichbare praktische Erfahrung. *

10 Jahre Erfahrung im Bereich ASIC- oder SoC-Design. *

Erfahrung mit Power-Design, Power-Modellierung, Power-Architektur oder Methoden/Techniken zur Energieeinsparung.

BEVORZUGTE QUALIFIKATIONEN: *

Master-Abschluss oder Promotion in Elektrotechnik, Technischer Informatik oder Informatik mit Schwerpunkt Computerarchitektur. *

5 Jahre Erfahrung in der Leitung mittelgroßer ASIC/SoC-Designteams mit Fokus auf Power-Design und Optimierung. *

Erfahrung in der Definition und Implementierung von chipweiten Power-Management-Architekturen und -Designs. *

Erfahrung in der Power-Modellierung, Messung und Korrelation über die Pre- und Post-Silicon-Phasen hinweg. *

Verständnis moderner Power- und Thermal-Management-Techniken auf Silizium- und Systemebene (einschließlich Dynamic Voltage and Frequency Scaling (DVFS), Turboing, Thermal Management und System-Level Tradeoffs). *

Fähigkeit, komplexe Power- und Performance-Probleme bei unklaren Rahmenbedingungen zu lösen.

ÜBER DIE STELLE

In dieser Rolle gestalten Sie die Zukunft der KI/ML-Hardwarebeschleunigung mit. Sie haben die Möglichkeit, modernste TPU (Tensor Processing Unit)-Technologie voranzutreiben, die die anspruchsvollsten KI/ML-Anwendungen von Google unterstützt. Sie werden Teil eines Teams sein, das Grenzen verschiebt und kundenspezifische Siliziumlösungen entwickelt, die die Zukunft der TPU von Google prägen. Sie tragen zur Innovation hinter Produkten bei, die von Millionen Menschen weltweit genutzt werden, und setzen Ihre Design- und Verifizierungsexpertise ein, um komplexe digitale Designs zu verifizieren, mit besonderem Fokus auf die TPU-Architektur und deren Integration in KI/ML-gesteuerte Systeme.

Als Power Design Manager im Silizium-Team von Google helfen Sie dabei, Lösungen zu liefern, die einen wesentlichen Einfluss auf die technische Infrastruktur haben, die Google ermöglicht. Sie übernehmen die technische Leitung einer Gruppe von Power-Design-Ingenieuren in einem innovativen und schnelllebigen Umfeld, mit Fokus auf ASIC-Power-Architektur, Design und Projektausführung. Sie verantworten und steuern komplexe technische Projekte von der Konzept-/Planungsphase bis hin zur Ausführung und zum Abschluss. Sie motivieren Ihr Team zu Höchstleistungen, um Designs zu liefern, die auf Anhieb mit optimalem Energieverbrauch funktionieren. Sie bringen Ihr Wissen und Ihre Erfahrung in der Power-Architektur und dem Design großer SoCs ein, arbeiten mit IP- und Chip-Anbietern sowie Herstellern zusammen und agieren über organisatorische Grenzen hinweg, um die richtigen Experten für technischen Input und die Umsetzung zu identifizieren, um SoC-zentrierte Produkte zu liefern, die für die Computing-Infrastruktur von Google entscheidend sind.

Das KI- und Infrastruktur-Team definiert neu, was möglich ist. Wir bieten Google-Kunden bahnbrechende Funktionen und Erkenntnisse, indem wir KI und Infrastruktur in beispiellosem Umfang, mit hoher Effizienz, Zuverlässigkeit und Geschwindigkeit bereitstellen. Zu unseren Kunden zählen Googler, Google Cloud-Kunden und Milliarden von Google-Nutzern weltweit.

Wir sind die treibende Kraft hinter den bahnbrechenden Innovationen von Google, ermöglichen die Entwicklung unserer modernsten KI-Modelle, liefern beispiellose Rechenleistung für globale Dienste und stellen die wesentlichen Plattformen bereit, mit denen Entwickler die Zukunft gestalten können. Von Software bis Hardware gestalten unsere Teams die Zukunft des weltweit führenden Hyperscale-Computings, wobei wichtige Teams an der Entwicklung unserer TPUs, Vertex AI für Google Cloud, Google Global Networking, Data Center-Betrieb, Systemforschung und vielem mehr arbeiten.

Die individuelle Vergütung wird durch Faktoren wie berufsbezogene Fähigkeiten, Erfahrung sowie relevante Ausbildung oder Weiterbildung bestimmt.

USA: $192000 - $278000 (USD) + 20% Bonus-Ziel + Aktienanteile + Sozialleistungen

Erfahren Sie mehr über die Leistungen bei Google [

VERANTWORTLICHKEITEN: *

Leitung eines Power-Design-Teams, das für Power-Architektur, Power-Optimierung und System-Power-Integration verantwortlich ist. *

Führung eines erfahrenen Teams sowie Definition der Prozesse, Methoden und Tools zur kontinuierlichen Verbesserung der Energieeffizienz der TPU-Designs. *

Beitrag zur Power-Modellierung von Designs und Steuerung der Konvergenz zu den Power-Zielen. *

Untersuchung, Spezifikation und Implementierung von architektonischen und mikroarchitektonischen Power-Optimierungstechniken sowie Definition von Best Practices und Methoden zur Erzielung energieeffizienter RTL-Designs. *

Zusammenarbeit mit funktionsübergreifenden Software- und Systemteams zur Entwicklung neuartiger Power-Management-Architekturen, um die Power-Ziele zu erreichen.

Sprachen

ASIC Power Manager, ML Accelerators

MINDESTQUALIFIKATIONEN: *

BEVORZUGTE QUALIFIKATIONEN: *

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VERANTWORTLICHKEITEN: *

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