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CPU Performance Engineer, Platform Architecture

PythonC++
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Über die Stelle

Das CPU Platform Architecture Team ist dafür verantwortlich, die Grenzen der Single-Threaded- und Multi-Threaded-CPU-Leistung zu erweitern, um das Nutzererlebnis vieler Apple Produkte zu verbessern. Das Team besteht aus Experten mit fundierter Erfahrung in Mikroarchitektur, ISA-Definition, Leistungsmodellierung, Leistungsaufnahmemodellierung und Workload-Analyse. Wir suchen eine hochmotivierte, innovative und selbstbewusste Persönlichkeit, die unser CPU Platform Architecture Team verstärkt und dabei hilft, die fortschrittliche Exploration für CPU-Designs der nächsten Generation für iPhone, iPad, Mac und Server voranzutreiben.

BESCHREIBUNG

Als CPU Performance Engineer mit Schwerpunkt auf dem Speicher-Subsystem sind Sie Teil eines Teams, das CPU- und Cache-Mikroarchitekturen definiert und optimiert. In enger Zusammenarbeit identifizieren Sie Leistungsengpässe, um Designverbesserungen zu finden und Konzepte zu deren Behebung zu bewerten. Sie arbeiten mit erfahrenen CPU- und SoC-Designern aus den Bereichen Mikroarchitektur und RTL zusammen, um die Machbarkeit von Ideen durch Modellierung zu bewerten, Konzepte und Modellkorrelationen zu verfeinern und neue Ansätze zu entwickeln. Die Rolle erfordert die Analyse von Single-Threaded- und Multi-Threaded-Workloads über bestehende und neue Produktkategorien hinweg, um Engpässe und Verbesserungspotenziale aufzudecken. Wir arbeiten als größeres CPU-Architektur- und Performance-Team zusammen, um die Simulationsumgebung zu pflegen und zu verbessern, datengestützte Entscheidungen zu ermöglichen und stets nach Wegen zu suchen, die Produktivität des gesamten Teams zu steigern.

MINDESTQUALIFIKATIONEN

  1. Bachelor-Abschluss
  1. Erfahrung in CPU- und SOC-Architektur sowie Mikroarchitektur
  1. Erfahrung mit Leistungssimulationsumgebungen
  1. Erfahrung in objektorientierter Programmierung mit C/C++
  1. Erfahrung in einer Skriptsprache wie Perl oder Python

BEVORZUGTE QUALIFIKATIONEN

  1. Kenntnisse über Techniken zur Toleranz von Speicherlatenz oder andere Aspekte des CPU-Speicher-Subsystems (z. B. Prefetching, Caching-Richtlinien)
  1. 3+ Jahre einschlägige Berufserfahrung
  1. Master-Abschluss oder Promotion in Elektrotechnik, Informationstechnik oder Informatik
  1. Verständnis gängiger Datenstrukturen und Algorithmen
  1. Vertrautheit mit SIMD-, Vektor- oder Beschleunigerarchitekturen
  1. Vertrautheit mit MP-Leistung
  1. Sicherer Umgang mit einem Umfeld voller Unsicherheiten und die Fähigkeit, sich in mehrdeutigen Situationen zurechtzufinden
  1. Erfahrung in einem forschungsorientierten Umfeld

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