Vereinigte Staaten
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Analog Devices
Principal Engineer, Design Verification
Vereinigte Staaten
Durham, North Carolina, United States
PythonC++Go
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Über Analog Devices
Analog Devices, Inc. (NASDAQ: ADI finance.yahoo.com/quote/ADI/?ltr=1) ist ein weltweit führender Halbleiterhersteller, der die physische und digitale Welt verbindet, um Durchbrüche am Intelligent Edge zu ermöglichen. ADI kombiniert analoge, digitale, KI- und Softwaretechnologien zu Lösungen, die den Klimawandel bekämpfen, Menschen und die Welt zuverlässig verbinden und Fortschritte in den Bereichen Automatisierung und Robotik, Mobilität, Gesundheitswesen, Energie und Rechenzentren vorantreiben. Mit einem Umsatz von mehr als $11 Milliarden im FY25 stellt ADI sicher, dass die Innovatoren von heute Ahead of What's Possible bleiben. Erfahren Sie mehr unter analog.com analog.com/en.html sowie auf LinkedIn linkedin.com/company/analog-devices und X x.com/ADI_News.
Principal Engineer, Design Verification
Das Data Center and Energy Team sucht einen hoch erfahrenen Principal Design Verification Engineer, der strategische Führung und technische Leitung für das gesamte Portfolio unseres Power Controller BU am Standort Durham, NC, von ADI übernimmt. Als technischer Leiter wird der Kandidat ein kleines Team von Verifizierungsingenieuren leiten und gleichzeitig die DV-Strategie, die Methodeninnovation und die Exzellenz bei der Ausführung über mehrere Projekte hinweg vorantreiben. Diese Rolle kombiniert praktische technische Expertise mit Führungsaufgaben und erfordert, dass der Kandidat hochmoderne Verifizierungsmethoden definiert und implementiert, Teammitglieder betreut und die Verifizierungsqualität über das gesamte Produktportfolio sicherstellt.
Analog Devices bietet eine Flexible Work Policy, die Remote-Arbeitstage und alternative Arbeitszeitmodelle beinhaltet.
Hauptverantwortlichkeiten
- Definition und Implementierung der DV-Strategie für die Gruppe, um die Ausrichtung an den Geschäftszielen und Produkt-Roadmaps sicherzustellen
- Entwicklung umfassender DV-Pläne für mehrere Projekte nach Bedarf
- Förderung der Einführung von hochmodernen DV-Methoden, einschließlich fortschrittlicher UVM-Architekturen, formaler Verifizierung, portablem Stimulus (PSS) und KI/ML-gestützten Verifizierungstechniken
- Festlegung von Verifizierungsmetriken, KPIs und Qualitäts-Gates zur Messung des Verifizierungsfortschritts und der Abdeckung
- Leitung und Betreuung eines kleinen Teams von Design-Verifizierungsingenieuren, Bereitstellung technischer Anleitung und Unterstützung bei der Karriereentwicklung
- Durchführung von Code-Reviews, Testbench-Architektur-Reviews und Methodologie-Bewertungen
- Zusammenarbeit bei der Rekrutierung, Interviewführung und Einarbeitung neuer Verifizierungstalente
- Architektur von skalierbarer, wiederverwendbarer Verifizierungsinfrastruktur über mehrere Projekte und Produktgenerationen hinweg
- Förderung der Evaluierung und Einführung neuer EDA-Tools, Verifizierungs-IPs und aufkommender Methoden
- Leitung der Entwicklung fortschrittlicher Testbench-Komponenten, einschließlich UVM-Umgebungen, formaler Verifizierungsansätze und Mixed-Signal- Verifizierungslösungen
- Unterstützung aller Projekte im Portfolio bei der DV-Planung, der Ausführungsaufsicht und der technischen Problemlösung
- Partnerschaft mit Analog- und Digital-Design-Teams zur Gewährleistung einer nähtlosen Integration und Verifizierung von Mixed-Signal-Designs
- Schnittstelle zu Produktentwicklung, Anwendungen und Silicon-Validierungsteams
- Vertretung des Verifizierungsteams in Projekt-Reviews, Design-Reviews und vor der Geschäftsleitung
- Entwicklung und Dokumentation von Best Practices, Richtlinien und Playbooks für die Verifizierungsorganisation
- Auf dem Laufenden bleiben über Branchentrends und Förderung der Einführung relevanter Innovationen
Mindestanforderungen
Mindestanforderungen
- Bachelor- oder Master-Abschluss in Elektrotechnik oder Informatik
- 10+ Jahre praktische Erfahrung in der SystemVerilog/UVM-basierten Verifizierung
- 3+ Jahre technische Führungserfahrung, einschließlich Mentoring von Ingenieuren, Leitung von Verifizierungsarbeiten an komplexen Projekten oder Management kleiner Teams
- Nachgewiesene Erfahrung in der Architektur von Verifizierungsumgebungen für komplexe Mixed-Signal-SoCs oder Power-Management-ICs
- Nachgewiesene Erfolgsbilanz bei der Definition und Implementierung von DV- Strategien für mehrere gleichzeitige Projekte
- Expertenkenntnisse in EDA-Tools und Automatisierung (Python, TCL, Perl, Shell) für den Aufbau von Verifizierungsinfrastrukturen und -abläufen
- Erfahrung mit formalen Verifizierungsmethoden und -werkzeugen (JasperGold, VC Formal oder gleichwertig)
- Starkes Verständnis der Coverage-Driven Verification, einschließlich funktionaler Coverage-Modellierung und Abschlussstrategien
- Ausgezeichnete Kommunikationsfähigkeiten mit der Fähigkeit, technische Inhalte für verschiedene Zielgruppen, einschließlich Führungskräften, zu präsentieren
Bevorzugte Qualifikationen
- Erfahrung mit dem Portable Stimulus Standard (PSS) und graphbasierten Verifizierungsansätzen - Tiefgehende Kenntnisse von Analog-/Mixed-Signal-Verifizierungstechniken, einschließlich SV-RNM-Modellierung
- Erfahrung mit der Verifizierung von ARM/RISC-V-basierten Subsystemen oder komplexen SoCs
- Expertise in der Verifizierung von Power-Management-ICs, einschließlich mehrphasiger DC-DC-Controller, Spannungsregler und Power Sequencing
- Erfahrung mit Spannungsschnittstellenprotokollen wie PMBUS, AVS, SVID, SVI3, I2C, SPI
- Kenntnisse von Emulations- und FPGA-Prototyping-Methoden für frühe Software-Aktivierung
- RTL-Design-Erfahrung, die eine starke Design-for-Verification-Perspektive bietet
- Erfahrung im Aufbau und Skalieren von Verifizierungsteams oder -kapazitäten
- Nachgewiesene Erfolgsbilanz bei der Förderung von Prozessverbesserungen, die die Verifizierungsqualität oder -effizienz messbar verbessert haben
- KI/ML-Tools für die Verifizierung – starkes Interesse und Erfahrung in der Nutzung von KI für Coverage-Abschluss, Testgenerierung, Debugging oder Produktivitätssteigerungen
- Beherrschung mehrerer Verifizierungsplattformen (Cadence, Synopsys, Mentor/Siemens)
- Erfahrung mit Continuous Integration/Continuous Verification (CI/CV) Pipelines
- Vertrautheit mit Cloud-basierten Verifizierungs- und verteilten Simulations-/Regressionsmanagement-Tools
- Expertise in der Versionskontrolle (Git, Perforce) und Kollaborations-Workflows
- Verilog, C/C++, SystemC für Modellierung und Verifizierung
- Starke analytische Fähigkeiten und Debugging-Fähigkeiten mit der Fähigkeit, komplexe Probleme zur Lösung zu bringen
Für Positionen, die Zugang zu technischen Daten erfordern, muss Analog Devices, Inc. möglicherweise eine Exportlizenzgenehmigung vom U.S. Department of Commerce - Bureau of Industry and Security und/oder dem U.S. Department of State - Directorate of Defense Trade Controls einholen. Daher müssen sich Bewerber für diese Position – mit Ausnahme von US-Bürgern, US-Daueraufenthaltsberechtigten und geschützten Personen gemäß 8 U.S.C. 1324b(a)(3) – möglicherweise einem Exportlizenzprüfungsverfahren unterziehen.
Analog Devices ist ein Arbeitgeber, der Chancengleichheit fördert. Wir pflegen eine Kultur, in der jeder die Möglichkeit hat, erfolgreich zu sein, unabhängig von Rasse, Hautfarbe, Religion, Alter, Herkunft, nationaler Herkunft, sozialer oder ethnischer Herkunft, Geschlecht, sexueller Orientierung, Geschlechtsidentität, Geschlechtsausdruck, Familienstand, Schwangerschaft, Elternstatus, Behinderung, Gesundheitszustand, genetischen Informationen, Militär- oder Veteranenstatus, Gewerkschaftszugehörigkeit und politischer Zugehörigkeit oder anderen gesetzlich geschützten Gruppen.
EEO ist Gesetz: Mitteilung über die Rechte der Bewerber gemäß dem Gesetz www1.eeoc.gov/employers/upload/eeoc_self_print_poster.pdf.
Job Req Type: Erfahren
Erforderliche Reise: Ja, 10% der Zeit
Schichtart: 1. Schicht/Tage
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