Lodestar

Engenheiro(a) FPGA de Aviônicos

Python
Tradução automática. Consulte o original.

SOBRE A LODESTAR

A missão da Lodestar é desenvolver a primeira capacidade de "Proteger e Defender" para ativos espaciais de alto valor em órbita. Nosso produto principal, MITHRIL, é nossa suíte de software de autonomia habilitada por IA, agnóstica de hardware, que nos permite aumentar qualquer espaçonave "off-the-shelf" com a capacidade de detectar, caracterizar e neutralizar reversivelmente ameaças orbitais de forma autônoma. Ao construir sobre o patrimônio espacial comprovado de nossos parceiros de ônibus de satélite de melhor classe e integrar totalmente o MITHRIL em uma única plataforma unificada, entregamos um serviço de "guarda-costas" espacial autônomo de ponta a ponta.

SOBRE A VAGA

Estamos buscando um(a) Engenheiro(a) FPGA de Aviônicos altamente motivado(a) para se juntar à nossa equipe multidisciplinar no desenvolvimento de sistemas espaciais de próxima geração. Você será responsável por projetar, implementar e validar arquiteturas de aviônicos avançadas para plataformas autônomas. Esta função oferece a oportunidade de trabalhar "hands-on" em todo o ciclo de vida, desde o conceito e simulação até testes de hardware e prontidão para lançamento.

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INFORMAÇÕES ADICIONAIS

As faixas de remuneração são determinadas pelo cargo, nível, local e alinhamento com dados de mercado. O nível individual e o salário base são determinados caso a caso e podem variar com base em habilidades relacionadas ao trabalho, educação, experiência, capacidades técnicas e equidade interna.

A Lodestar é regida com base em mérito, competência e qualificações e não será influenciada de forma alguma por raça, cor, religião, gênero, origem nacional/etnia, status de veterano, status de deficiência, idade, orientação sexual, identidade de gênero, estado civil, deficiência mental ou física ou qualquer outro status legalmente protegido.

O QUE VOCÊ FARÁ

  1. Projetar, desenvolver e verificar RTL em SystemVerilog e/ou Verilog para alvos FPGA e SoC.
  1. Realizar "bring-up" e integrar interfaces SerDes e interfaces de memória.
  1. Desenvolver "testbenches" e provas formais para garantir a correção em nível de módulo e sistema.
  1. Realizar depuração de hardware e testes em nível de sistema usando osciloscópios, analisadores lógicos e outros instrumentos de laboratório.
  1. Colaborar estreitamente com as equipes de sistemas, software de aviônicos e hardware para garantir a integração perfeita dos projetos de RTL nos sistemas de voo.
  1. Contribuir para a documentação de projeto, planos de teste e as evidências necessárias para revisões de projeto, e apoiar testes de qualificação ambiental e verificação (EMC, vibração, vácuo térmico, etc.).

QUALIFICAÇÕES

  1. Bacharelado / Mestrado em Engenharia Elétrica, área relacionada, ou experiência equivalente.
  1. Proficiência em SystemVerilog e/ou Verilog, com sólida compreensão dos princípios de design RTL.
  1. Experiência prática com pelo menos uma família ou ecossistema de FPGA.
  1. Familiaridade com interfaces e protocolos digitais comuns (SPI, I2C, UART).
  1. Experiência com simulação e verificação formal.
  1. Experiência em lidar com cruzamentos de domínio de clock, análise de timing estático e fechamento de timing.
  1. Conforto com scripting para automação, idealmente em Python e/ou TCL.
  1. Experiência prática com equipamentos de teste de laboratório, incluindo osciloscópios, analisadores lógicos e fontes de alimentação.
  1. Comunicação clara e uma abordagem proativa e curiosa para aprender novas ferramentas e ideias.

INFORMAÇÕES IMPORTANTES

Por motivos de segurança, verificações de antecedentes serão realizadas antes de qualquer oferta de emprego feita a um candidato. Essas verificações incluirão verificações de nacionalidade, pois é um requisito desta posição que você seja elegível para acessar equipamentos e dados regulamentados pelas Regulamentações de Tráfico Internacional de Armas dos Estados Unidos (ITAR).

Sob essas regulamentações, você pode ser inelegível para esta função se não possuir cidadania de um dos seguintes países: Albânia, Austrália, Áustria, Bélgica, Bulgária, Canadá, Croácia, Chipre, República Tcheca, Dinamarca, Estônia, Finlândia, França, Alemanha, Grécia, Hungria, Islândia, Irlanda, Itália, Japão, Letônia, Lituânia, Luxemburgo, Malta, Montenegro, Países Baixos, Nova Zelândia, Macedônia do Norte, Noruega, Polônia, Portugal, Romênia, Eslováquia, Eslovênia, Espanha, Suécia, Suíça, Turquia, Reino Unido ou Estados Unidos, ou se possuir dupla cidadania ou nacionalidade inelegível. Para mais informações sobre essas regulamentações, clique aqui Regulamentações ITAR.

federalregister.gov/documents/2020/01/23/2020-00574/international-traffic-in-arms-regulations-us-munitions-list-categories-i-ii-and-iii

HABILIDADES E EXPERIÊNCIA PREFERENCIAIS

  1. Interfaces de alta velocidade: MIPI-CSI, QSGMII, SGMII, 10GBASE-KR, PCIe ou similar.
  1. Interfaces de memória: DDR3, DDR4, LPDDR4 ou similar.
  1. Design de SoC: integração de subsistemas de processador RISC-V ou Arm, protocolos AXI/APB/AHB e "bring-up" de Linux embarcado.
  1. Experiência com design de PCB para projetos digitais de alta velocidade.
  1. Sólido conhecimento de metodologias de verificação, cobertura funcional, asserções e verificação aleatória restrita.
  1. Experiência com FPGAs Microchip e ferramentas de desenvolvimento.
  1. Experiência em eletrônica espacial e práticas de design de alta confiabilidade, incluindo análise de efeitos de radiação, arquiteturas tolerantes a falhas e processos de qualificação para sistemas espaciais.
  1. Time-Sensitive Networking (TSN) ou outras redes determinísticas.

REMUNERAÇÃO E BENEFÍCIOS

  • Faixa Salarial:
  • (E1) Engenheiro(a) Júnior: £30,000 - £55,000 / ano
  • (E2) Engenheiro(a) Pleno(a): £55,000 - £75,000 / ano
  • Incentivos acionários significativos como parte de nosso plano de opções para funcionários.
  • Férias Remuneradas Ilimitadas (PTO).
  • Cobertura médica, odontológica e de visão abrangente.
  • Previdência complementar.
  • Faça parte de uma equipe ágil, dinâmica, multidisciplinar e colaborativa 🏴‍☠️

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