Estados Unidos
Retym
Apple
Engenheiro de Design e Integração de ASIC
Estados Unidos
Cupertino, California, United States
Python
Tradução automática. Consulte o original.
Sobre a oportunidade
Imagine o que você poderia fazer aqui. Na Apple, novas ideias têm o poder de se transformar rapidamente em produtos, serviços e experiências de cliente extraordinários. Traga paixão e dedicação ao seu trabalho e não há limites para o que você pode realizar. Pessoas sofisticadas e trabalhadoras, além de tecnologias inspiradoras e inovadoras, são a norma aqui. As pessoas que trabalham aqui reinventaram setores inteiros com todos os produtos de Hardware da Apple. A mesma paixão pela inovação que dedicamos aos nossos produtos também se aplica às nossas práticas, fortalecendo nosso compromisso de deixar o mundo melhor do que o encontramos. Junte-se a nós para ajudar a entregar o próximo excelente produto da Apple. Você gosta de trabalhar em desafios que ninguém resolveu ainda? Como membro do nosso grupo complexo, você terá a oportunidade excepcional e gratificante de criar produtos futuros que encantarão e incentivarão milhões de clientes da Apple todos os dias. Você está pronto para se juntar a uma equipe que está transformando a tecnologia de hardware? Estamos procurando um engenheiro dedicado para se juntar à nossa empolgante equipe de solucionadores de problemas.
DESCRIÇÃO
Como Engenheiro de Design/Integração de ASIC, suas responsabilidades abrangem vários aspectos do design de SOC:
- Escrever especificações de microarquitetura e design
- Projetar, implementar e depurar designs lógicos complexos
- Integrar IPs complexos ao SOC
- Apoiar todas as atividades de integração de front-end como Lint, CDC, RDC, Síntese e ECO
- Trabalhar com outros especialistas das equipes de Design de SOC, Verificação, Emulação, STA e Design Físico
- Colaborar com equipes de software e sistemas para garantir alta qualidade
QUALIFICAÇÕES MÍNIMAS
- Bacharelado e no mínimo 10 anos de experiência relevante no setor
QUALIFICAÇÕES PREFERENCIAIS
- Experiência em design lógico RTL com Verilog
- Experiência comprovada e sólido conhecimento em metodologias de CDC e baixo consumo de energia
- Familiaridade com linguagens de script como Perl, Python ou Tcl
- Familiaridade com ferramentas e fluxos de trabalho de GenAI
- Experiência em escrever especificações e convertê-las em design
- Experiência com múltiplos domínios de clock e interfaces assíncronas
- Experiência prática em todo o processo de desenvolvimento de chips com proficiência em ferramentas e metodologias de front-end
- Experiência ou conhecimento em arquitetura de sistemas, integração de CPU e IP, e design de gerenciamento de energia/clock
- Fortes habilidades de comunicação entre equipes internas multifuncionais
- Familiaridade com conceitos de software e sistemas operacionais é um diferencial
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