Estados Unidos
Siemens
Apple
Ingeniero de diseño de PLL
Estados Unidos
Cupertino, California, United States
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Sobre la oportunidad
En Apple, nuestros productos están revolucionando la forma en que vive la gente en todo el mundo. Dentro de nuestro grupo de señal analógica/mixta, tu papel será crucial para ampliar los límites de lo que nuestra tecnología puede lograr. Nos dedicamos a crear hard IPs innovadores y de alta calidad que superan lo ordinario, adaptándonos a la creciente complejidad de los diseños de SOC/PHY y multiplicando los proyectos dentro de ajustados calendarios de producción. Nuestro entorno prospera gracias a estos desafíos, impulsado por un equipo de personas excepcionales apasionadas por el aprendizaje continuo y por generar un impacto sustancial. Si destacas en entornos dinámicos, disfrutas de la resolución colaborativa de problemas y buscas tener un impacto social a través de tu trabajo, podrías ser el candidato ideal para nuestro equipo. En Apple, te unirás a una cultura que te anima a tomar las riendas de tu carrera, con el apoyo de compañeros comprometidos a marcar la diferencia.
DESCRIPCIÓN
En este puesto, aprovecharás tu experiencia para desarrollar sintetizadores de frecuencia de vanguardia para una variedad de aplicaciones, incluyendo Compute, SoC, SerDes y tecnologías celulares. Tu trabajo contribuirá directamente a mantener el liderazgo en innovación y la presencia en el mercado de Apple, estableciendo nuevos estándares en la industria tecnológica.
REQUISITOS MÍNIMOS
- Grado en Ingeniería Eléctrica (BSEE) con al menos 10 años de experiencia relevante.
REQUISITOS PREFERENTES
- Experiencia técnica: Competencia demostrada en arquitectura y diseño de circuitos de PLL/FLL y síntesis de frecuencia. Esto incluye enfoques digitales y analógicos, diseño de DCO/VCO tanto RO como LC, Fractional-N, SSC, técnicas de cancelación de Spur y Jitter, etc. Buen conocimiento de band gaps, circuitos de polarización, amplificadores operacionales, LDOs, retroalimentación y técnicas de compensación.
- Dominio de la sincronización (Clocking): Profundo conocimiento de los fundamentos de la sincronización, con una sólida comprensión del ruido de fase, análisis de jitter, presupuestación y dinámica de bucles de retroalimentación.
- Simulación y modelado: Habilidad en el desarrollo de modelos en System Verilog y en la realización de simulaciones de comportamiento para explorar el rendimiento de nuevas arquitecturas y su impacto en la dinámica de bucles. La capacidad de diseñar/depurar RTL es una ventaja.
- Atención al detalle: Enfoque excepcional en la comprensión de los problemas planteados y sus impactos sistémicos, garantizando minuciosidad en la resolución de problemas.
- Innovación y aprendizaje: Historial de innovación y aprendizaje autodirigido, con habilidades de liderazgo demostradas y una mentalidad de crecimiento.
- Colaboración en equipo: Destacadas capacidades de trabajo en equipo combinadas con una gran productividad y habilidades de scripting, idealmente con experiencia en el uso de herramientas de diseño estándar de la industria.
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